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硬件描述语言与可编程器件
授课老师:蔡觉平、李振荣、汤华莲
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适用专业】:集成电路设计与集成系统       

先修课程】:数字电路与逻辑设计

            

课程的教学目标与任务

目标:本课程是集成电路设计与集成系统专业选修课,通过本课程学习,掌握Verilog HDL语言的基本语法和编程方法,掌握运用硬件描述语言(HDL)进行集成电路设计的基础知识和基本技能,掌握采用Verilog HDL进行数字集成电路设计,掌握可编程逻辑器件的原理和使用,为数字集成电路设计打下良好的基础。


任务:掌握硬件描述语言要素和词法,熟悉行为级描述、结构级描述和开关级描述的要求和特点,掌握采用硬件描述语言描述各层次的方法,了解集成电路层次化设计的思想。掌握硬件描述语言的基本设计方法和测试方案,掌握采用硬件描述语言进行数字集成电路设计的基本技能,了解可编程逻辑器件的基本原理和使用方法,具备采用Verilog HDL在可编程逻辑器件上进行数字电路设计的能力。


讲师简介
  • 蔡觉平

    西安电子科技大学微电子学院,教授 博士生导师。1998年和2001年在西安电子科技大学,分别获得获通信工程专业工学学士学位和通信与信息系统专业工学硕士学位,2004年在上海交通大学获得通信与信息系统专业博士学位。 2004年1月~2005年11月,在STMicroelectronics公司北京研发中心任高级研究员。2005年11月进入西安电子科技大学从事大规模集成电路研究工作。主持国家863项目、国家自然科学基金等多项科研任务。主要方向为MPSoCs芯片设计和低功耗设计。2008年被评为校优秀青年教师,2013年被评为校优秀教师。目前是IEEE Trans. on Wireless Communication、IEEE Trans. on Broadcasting 和电子学报等国内外著名期刊审稿人,主要研究方向为纳米级大规模SoC设计和通信网络设计等。2002年后,在IEEE Trans.、IEEE Conference、Science in China (F)、中国科学(E辑)、物理学报国内外著名期刊及国际会议上发表学术论文近五十篇,其中SCI、EI及ISTP检索近三十篇,申请国家专利和国防专利20项,授权5项,获得省部级科技进步二等奖两项。 本课题组隶属于宽带隙半导体材料国防重点学科实验室,项目研究人员为西安电子科技大学创新团队成员。研究所需主要实验设备由教育部重点实验室解决,课题的研究成员由教授、副教授、讲师和博士、硕士研究生组成,具有创新精神,科研能力强。本课题研究成员长期从事大规模集成电路设计、通信网络和无线通信信号处理技术等方面的研究,在基于FPGA、DSP和网络处理器平台下的通信网络设备研制方面积累了丰富的经验,取得了大量的研究成果。
  • 李振荣

    西安电子科技大学微电子学院,副教授,博士生导师,硕士生导师。主要从事射频/微波、智能生物感知、短距离无线通信、超大规模SoC等集成电路的研究和设计工作,在国内外知名刊物上发表EI和SCI收录文章二十余篇,申请国家发明专利三十余项,目前是Microelectronics Journal等期刊审稿人。近几年,主持多项国家自然科学基金项目、省自然基金项目和国家部委科研项目,并作为主要负责人承担多项国家科技重大专项和国家部委科研项目的研发。2002年-2006年,先后在EPSON技术有限公司和华为海思半导体有限公司从事超大规模集成电路及电路系统研发工作。2017年美国佛罗里达大学进行访学学者。主讲课程《数字逻辑与集成设计》、《硬件描述语言与可编程设计》、《生物微纳电子技术》课程,承担的“可编程逻辑器件实验项目”获得学校新实验开发评比一等奖。
  • 汤华莲

    西安电子科技大学微电子学院教师。自任职以来,主讲 《硬件描述语言》,《Verilog HDL设计与综合》及《计算机导论与C程序设计》等本科及研究生课程,教学水平受到同行及学生的一致认可。承担校级教学改革项目2项,发表教改论文1篇。指导学生参加“全国大学生集成电路创新创业大赛”等各类竞赛,获得全国二等奖及优秀指导教师奖等殊荣。